AR8031-AL1B


10/100/1000Mbps Ethernet PHY, RGMII/SGMII, 802.3az EEE, 1588v2, WoL, Green ETHOS, 3.3V, QFN-48 6x6mm, -40~85C

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AR8031-AL1B

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QFN-48 EP (6 x 6 x 0,8 mm, paso de 0,4 mm)

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Descripción

El AR8031-AL1B de Qualcomm (anteriormente Atheros Communications) es un PHY (transmisor-receptor de capa física) Ethernet de tres velocidades a 10/100/1000 Mbps de un solo puerto de cuarta generación en un encapsulado de almohadilla expuesta QFN de 6 x 6 mm y 48 patillas. Especificaciones clave: Compatible con IEEE 802.3 (10BASE-T, 100BASE-TX, 1000BASE-T); interfaces MAC RGMII y SGMII; SerDes integrado compatible con fibra 1000BASE-X y 100BASE-FX; compatibilidad con IEEE 802.3az Energy Efficient Ethernet (EEE); SmartEEE para dispositivos MAC/SoC heredados; compatibilidad con IEEE 1588v2 y Synchronous Ethernet; Wake-on-LAN (WoL); tecnología de ahorro de energía Atheros Green ETHOS; alimentación única de 3,3 V; corriente de alimentación 113.7 mA máximo; velocidad de datos de hasta 1 Gbps; resistencias de terminación MDI integradas; ecualizadores adaptativos digitales, canceladores de eco y canceladores NEXT integrados; cruce MDI/MDIX automático y corrección de polaridad; intercambio automático de canales (ACS); prueba de diagnóstico de cables (CDT); múltiples modos de loopback; protección contra eventos de descarga del cable (CDE) de más o menos 6 kV; protección contra sobretensiones de más o menos 750 V en modo diferencial y más o menos 4 kV en modo común; soporte de tramas jumbo de hasta 10 KB; alcance de cable ampliado hasta 140 metros CAT5; temperatura de funcionamiento de -40 a +85 grados C (grado industrial). El sufijo AL1B indica QFN EP de 48 patillas con embalaje en bandeja. Estado del producto transferido de Atheros a Qualcomm.

El AR8031-AL1B de Qualcomm (desarrollado originalmente por Atheros Communications, adquirida posteriormente por Qualcomm) es un transceptor PHY Gigabit Ethernet de puerto único de cuarta generación que proporciona conectividad Ethernet de cobre y fibra a 10/100/1000 Mbps. Es uno de los PHY Gigabit Ethernet más utilizados en redes integradas, equipos empresariales y dispositivos de consumo.

El AR8031 admite conexiones RGMII (Reduced Gigabit Media Independent Interface) y SGMII (Serial Gigabit Media Independent Interface) a la capa MAC, lo que lo hace compatible con prácticamente todos los procesadores, SoC y ASIC de conmutación modernos con capacidad Ethernet. La interfaz RGMII es la más común para procesadores integrados (NXP i.MX, TI Sitara, Xilinx Zynq, etc.), mientras que SGMII se utiliza para diseños de conmutadores y routers de mayor densidad.

El SerDes integrado permite al AR8031 soportar interfaces de fibra (1000BASE-X y 100BASE-FX) además de cobre (1000BASE-T, 100BASE-TX, 10BASE-T). Este modo combinado de cobre y fibra permite conexiones de módulos SFP y aplicaciones de convertidor de medios sin necesidad de un chip SerDes externo.

La compatibilidad con IEEE 802.3az Energy Efficient Ethernet (EEE) reduce significativamente el consumo de energía durante los periodos de baja utilización de datos, al entrar en un estado de inactividad de bajo consumo (LPI) entre tramas. La función SmartEEE amplía las ventajas de EEE a sistemas con dispositivos MAC/SoC que no soportan 802.3az de forma nativa, gestionando de forma autónoma las transiciones de estado LPI dentro de la propia PHY.

La tecnología de ahorro de energía Atheros Green ETHOS va más allá de la EEE al ajustar dinámicamente la potencia de procesamiento del DSP en función de la longitud real del cable. Los cables más cortos requieren menos ecualización y cancelación de eco, lo que permite al PHY reducir automáticamente el consumo de energía del DSP. Este ahorro de energía adaptado a la longitud del cable puede reducir el consumo de energía de 1000BASE-T hasta en un 40% en cables cortos en comparación con los PHY convencionales.

La compatibilidad con IEEE 1588v2 y Ethernet síncrona hace que el AR8031 sea adecuado para aplicaciones de red sensibles al tiempo que requieren una sincronización de reloj precisa, como estaciones base de telecomunicaciones, automatización industrial y sistemas de comercio financiero. La salida de reloj recuperada permite que el PHY sirva como referencia de temporización para el sistema.

Las resistencias de terminación MDI integradas simplifican el diseño de la placa de circuito impreso al eliminar 8 componentes de resistencia externos que, de otro modo, serían necesarios entre el PHY y el conector RJ-45/magnético. Esto reduce el coste de la lista de materiales y el área de la placa de circuito impreso, al tiempo que mejora la integridad de la señal.

La función de prueba de diagnóstico de cables (CDT) permite al sistema detectar y notificar fallos en los cables (abierto, cortocircuito, desajuste de impedancia) y estimar la distancia hasta el fallo, lo que permite la localización remota de averías sin necesidad de inspección física.

El AR8031-AL1B se utiliza ampliamente en plataformas Linux embebidas (NXP i.MX6/i.MX8, TI AM335x/AM572x, Xilinx Zynq) con soporte de controlador de kernel Linux de línea principal. El dispositivo se gestiona a través de una interfaz MDIO (MDC/MDIO) y se puede configurar mediante ajustes de registro y opciones de correa en el encendido.

El AR8031-AL1B funciona como transceptor de capa física (PHY) en un sistema Ethernet, implementando las funciones de capa física IEEE 802.3 para transmitir y recibir datos a través de cable de cobre de par trenzado o medios de fibra óptica.

Subcapa de codificación física (PCS): La PCS se encarga de la codificación y descodificación de las tramas Ethernet para su transmisión a través del medio físico. Para 1000BASE-T, la PCS implementa la codificación 4D-PAM5 (modulación de amplitud de impulsos de 4 dimensiones y 5 niveles), en la que se codifican 2 bits por símbolo en cada uno de los 4 pares de hilos, con lo que se consigue un caudal de datos de 1000 Mbps. Para 100BASE-TX, el PCS implementa la codificación 4B/5B con señalización MLT-3. Para 10BASE-T, el PCS implementa la codificación Manchester.

Conexión al medio físico (PMA): La subcapa PMA realiza las funciones de front-end analógico, incluido el DAC (convertidor digital-analógico) para la transmisión, el ADC (convertidor analógico-digital) para la recepción y el circuito híbrido que separa las señales de transmisión y recepción en el mismo par de hilos (para el funcionamiento full-duplex 1000BASE-T, en el que los cuatro pares transportan tráfico bidireccional simultáneo).

Cancelación de eco y cancelación NEXT: En el modo dúplex completo 1000BASE-T, los cuatro pares transportan simultáneamente señales de transmisión y recepción. El AR8031 utiliza ecualizadores adaptativos digitales totalmente integrados, canceladores de eco y canceladores de diafonía cercana (NEXT) para separar la señal recibida deseada de la señal transmitida (eco) y de la diafonía de pares adyacentes. El cancelador de eco modela la ruta de fuga de transmisión a recepción y resta el eco estimado de la señal recibida. Los canceladores NEXT modelan de forma similar el acoplamiento de diafonía entre pares y restan la diafonía estimada. Estos filtros adaptativos actualizan continuamente sus coeficientes durante el funcionamiento normal para seguir los cambios en las características del cable y la temperatura.

Autonegociación: El AR8031 implementa la autonegociación IEEE 802.3u para determinar automáticamente la velocidad común más alta y la configuración dúplex con el socio de enlace. Durante la autonegociación, el PHY intercambia ráfagas de impulsos de enlace rápido (FLP) que anuncian sus capacidades (10/100/1000 Mbps, dúplex medio/completo, EEE, etc.). Se selecciona el máximo común denominador. El AR8031 también admite la funcionalidad de página siguiente para la autonegociación 1000BASE-T.

Interfaz MAC RGMII/SGMII: La interfaz MAC transporta los datos Ethernet entre el PHY y la capa MAC en el procesador o conmutador. En el modo RGMII, los datos se transfieren en una interfaz de 12 patillas (TXD[3:0], TXC, TX_CTL, RXD[3:0], RXC, RX_CTL) a una velocidad de reloj de 125 MHz para un funcionamiento de 1000 Mbps. El RGMII admite los modos de retardo interno y externo en la ruta RX para cumplir los requisitos de temporización. En el modo SGMII, los datos se transfieren a través de una interfaz serie diferencial de 2 patillas (RX_p/n, TX_p/n) a 1,25 Gbaudios, lo que resulta más eficiente para diseños multipuerto.

SerDes e interfaz de fibra: El SerDes (serializador/deserializador) integrado proporciona una interfaz de fibra 1000BASE-X o 100BASE-FX. En el modo 1000BASE-X, el SerDes funciona a 1,25 Gbaudios utilizando codificación 8B/10B, adecuada para la conexión directa a módulos transceptores ópticos SFP. El modo de fibra se selecciona a través de la configuración del registro MDIO o las opciones de correa de hardware.

Ethernet con eficiencia energética (EEE): El AR8031 es compatible con IEEE 802.3az EEE, que reduce el consumo de energía durante los periodos de baja utilización del enlace. Cuando la EEE está activa y no hay datos que transmitir, el PHY entra en un estado de inactividad de bajo consumo (LPI) en el que el transmisor se apaga y el receptor funciona en un modo de consumo reducido. El PHY envía periódicamente señales de actualización para mantener la adaptación del ecualizador del enlace. Cuando es necesario transmitir datos, el PHY sale del estado LPI y reanuda el funcionamiento normal en unos pocos microsegundos.

IEEE 1588v2 PTP: El AR8031 es compatible con el Protocolo de Tiempo de Precisión (PTP) definido por IEEE 1588v2, que permite la sincronización de reloj en submicrosegundos entre nodos de red. El PHY puede marcar la hora de llegada y salida de los paquetes PTP con una precisión de nanosegundos, lo que permite una sincronización horaria precisa para la automatización industrial, las telecomunicaciones y las aplicaciones financieras.

Diagnóstico de cables: La función de prueba de diagnóstico de cables (CDT) utiliza reflectometría en el dominio del tiempo (TDR) para analizar las características del cable. Al transmitir un impulso de prueba y medir la señal reflejada, el PHY puede determinar la longitud del cable, detectar circuitos abiertos, cortocircuitos y desajustes de impedancia, y estimar la distancia a cualquier fallo.

Grupo Pin Nombre Tipo Descripción
Interfaz MDIO MDC, MDIO Controlar Interfaz de gestión MDIO para acceso a registros; entrada de reloj MDC de hasta 12,5 MHz; datos bidireccionales MDIO; protocolo de la cláusula 22 con dirección PHY establecida por pines de correa; se utiliza para configuración, supervisión de estado y diagnóstico; MDC está controlada por la MAC/SoC; MDIO requiere un pull-up externo de 4,7 kOhmios.
Interfaz RGMII TXD[3:0], TXC, TX_CTL, RXD[3:0], RXC, RX_CTL E/S digitales Interfaz MAC RGMII para transferencia de datos a 10/100/1000 Mbps; TXD[3:0] y TXC transportan datos de transmisión a 125 MHz para 1000 Mbps; RXD[3:0] y RXC transportan datos de recepción; TX_CTL y RX_CTL indican datos válidos y condiciones de error; tensión de E/S de 2,5 V o 3,3 V (ajustada mediante correa o registro); admite retardo de RX interno (1,5-2,0 ns) y modos de retardo externo.
Interfaz SGMII SGMII_TX_p/n, SGMII_RX_p/n E/S diferenciales Interfaz MAC SGMII para transferencia de datos Gigabit en serie; señalización diferencial de 1,25 Gbaudios; alternativa a RGMII que ahorra pines (2 pares frente a 12 pines); acoplada en CA con condensadores de 0,1 uF; se selecciona mediante correa o registro; se utiliza principalmente en conexiones ASIC de conmutadores y enrutadores.
Interfaz MDI TXP_0/TXN_0 a TXP_3/TXN_3, RXP_0/RXN_0 a RXP_3/RXN_3 E/S analógicas Interfaz dependiente del medio para conexión a magnéticos/RJ-45; 4 pares diferenciales para 1000BASE-T; resistencias de terminación MDI de 50 Ohm integradas (no se necesitan resistencias externas); conexión a través de magnéticos Ethernet (relación 1:1) al conector RJ-45; protección contra eventos de descarga del cable (CDE) más o menos 6 kV
Fibra SerDes SD_TX_p/n, SD_RX_p/n E/S diferenciales Interfaz SerDes 1000BASE-X / 100BASE-FX para conexión de fibra; 1,25 Gbaudios para 1000BASE-X; acoplado a CA; puede conectarse directamente al módulo SFP; se selecciona mediante correa o registro; el modo de fibra admite conmutación por error automática a cobre (modo combinado)
Potencia VDD33, VDDIO, GND Potencia VDD33: alimentación analógica y digital de 3,3 V; VDDIO: alimentación de E/S de 2,5 V o 3,3 V para RGMII (seleccionable); GND: conexiones a tierra; deben conectarse varios pines VDD33 y GND; puentee cada pin VDD33 con un condensador cerámico de 100 nF; añada un condensador de masa de 10 uF cerca del dispositivo.
Configuración pasadores de CORREA Entrada Múltiples pines de correa establecen la configuración inicial en el encendido (dirección PHY, modo de interfaz MAC, voltaje RGMII, configuración LED, etc.); cada pin de correa tiene un pull-up o pull-down interno; una resistencia externa o una conexión directa a VDD/GND selecciona la opción deseada; los valores se bloquean en el reinicio de encendido
Grupo Pin Nombre Tipo Descripción
Reloj XTAL_IN, XTAL_OUT E/S analógicas Oscilador de cristal o entrada de reloj externa; conecte un cristal de 25 MHz (20 ppm) con condensadores de carga; alternativamente, aplique una señal de reloj de 25 MHz a XTAL_IN y deje XTAL_OUT sin conectar; la referencia de 25 MHz se multiplica internamente por PLL para generar los relojes de muestreo y serialización necesarios.
LED LED[2:0] Salida Salidas LED para indicación de enlace/actividad/velocidad; accionamiento directo del LED mediante resistencia limitadora de corriente; comportamiento del LED configurable mediante registros MDIO; salida activa-baja; puede indicar velocidad, actividad, dúplex y colisión de enlace 10/100/1000.
Interrumpir INT Salida Salida de interrupción a MAC/SoC; drenaje abierto activo-bajo; se activa al cambiar el estado del enlace, finalizar la autonegociación, detectar energía, WoL y condiciones de error; requiere resistencia de pull-up externa; enmascarable mediante registros MDIO
Restablecer RST_N Entrada Restablecimiento de hardware activo-bajo; pull bajo durante un mínimo de 10 ms para restablecer el PHY; pull-up interno con debounce; todos los registros vuelven a los valores predeterminados (o seleccionados por correa); debe afirmarse después del encendido para garantizar una inicialización fiable.
Aplicación Descripción
Linux integrado SBC Ethernet Proporciona Gigabit Ethernet a ordenadores monoplaca y SOM basados en NXP i.MX6/i.MX8, TI AM335x/AM57x o Xilinx Zynq; la interfaz RGMII se conecta directamente a la MAC del procesador; compatibilidad con el controlador principal del núcleo Linux (controlador at803x); el cristal de 25 MHz proporciona el reloj de referencia; alimentación única de 3,3 V; la terminación MDI integrada simplifica el diseño de la placa de circuito impreso.
Equipos de red para empresas Gigabit Ethernet PHY para conmutadores, routers y cortafuegos; interfaz SGMII para conexiones ASIC de conmutadores de alta densidad; IEEE 802.3az EEE reduce el consumo de energía en entornos de centros de datos; SmartEEE permite EEE con controladores MAC heredados; el diagnóstico por cable permite la solución remota de problemas.
Automatización industrial Conectividad Ethernet industrial con protocolo de tiempo de precisión IEEE 1588v2 para aplicaciones sensibles al tiempo; Ethernet síncrona con salida de reloj recuperada; alcance de cable ampliado (140 m) para tendidos de cable industriales; protección CDE adecuada para entornos de planta; rango de temperatura industrial de -40 a 85 C
Módulo SFP / Convertidor de medios Modo combinado fibra-cobre mediante SerDes integrado; 1000BASE-X se conecta directamente al módulo óptico SFP; conmutación automática por error entre cobre y fibra; modo RGMII para conexión MAC; ideal para convertidores de medios SFP+ y convertidores fibra-cobre; admite 100BASE-FX para fibra heredada.
Estación base de telecomunicaciones Proporcionan conectividad Ethernet backhaul en estaciones base de telefonía móvil; IEEE 1588v2 y Ethernet síncrona para una sincronización precisa del reloj en toda la red; el bajo consumo reduce la carga térmica en carcasas exteriores; Wake-on-LAN permite la gestión remota de los modos de ahorro de energía.
Modelo Fabricante Compatibilidad Diferencia clave
AR8033-AL1B Qualcomm Misma familia, distintas funciones La misma familia AR8031 Gigabit PHY en QFN-48; características similares con diferente subconjunto de características; misma interfaz RGMII/SGMII; mismo soporte de controlador; verifique las diferencias de características específicas en la hoja de datos; compatible con patillas en muchos diseños.
RTL8211E-VB Realtek Equivalente funcional Gigabit Ethernet PHY en QFN-40 o QFN-48; interfaz RGMII; IEEE 802.3az EEE; ampliamente utilizado en aplicaciones de consumo e integradas; muy popular en Raspberry Pi y otros SBC; menor coste; no admite SGMII ni fibra; el mapa de registros diferente requiere la adaptación del controlador.
KSZ9031RNX Microchip Equivalente funcional Gigabit Ethernet PHY en QFN-48; interfaz RGMII; IEEE 802.3az EEE; compatibilidad con IEEE 1588v2; conjunto de funciones similar; mapa de registros diferente; controlador de kernel Linux disponible (micrel_phy); popular en aplicaciones industriales; precio comparable
DP83867IR TI Mayor rendimiento Gigabit Ethernet PHY en QFN-48; interfaz RGMII/SGMII; IEEE 802.3az EEE; IEEE 1588v2; Ethernet síncrona; ajuste de retardo interno RGMII; mayor rendimiento y más funciones; mayor coste; popular en telecomunicaciones e industria; excelente compatibilidad con controladores Linux.
VSC8514 Microsemi Alternativa de puerto cuádruple PHY Gigabit Ethernet de cuatro puertos en QFN-128; cuatro canales PHY independientes en un solo encapsulado; interfaz MAC RGMII o QSGMII; mayor integración para diseños multipuerto; no compatible con pines; se utiliza cuando se necesitan cuatro puertos Ethernet en un solo chip.
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10/100Mbps Ethernet PHY, MII/RMII, auto-negotiation, 32-QFN 5x5mm, industrial

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32-VFQFN (5.0 x 5.0 x 0.9 mm)
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WiSoC 802.11b/g/n 2T2R altamente integrado con CPU MIPS 24Kc de 1 GHz, 128 MB de DDR2 integrada, conmutador FE de 5 puertos con RGMII, PCIe Gen1, USB 2.0 y motor de seguridad por hardware en encapsulado DR-QFN128.

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DR-QFN128 (10 mm x 10 mm, paso de 0,4 mm)
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Hemos obtenido una serie de certificaciones profesionales y construido nuestro propio laboratorio de pruebas profesional.Esto asegura que cada producto que entregamos a nuestros clientes cumple con los más altos requisitos de calidad.Llevamos a cabo pruebas en estricta conformidad con los procedimientos para garantizar la calidad del producto estable y parámetros precisos.Para garantizar piezas originales genuinas, también cooperamos con instituciones de pruebas de terceros confiables para la inspección de calidad estricta.Siempre damos gran importancia a la calidad y cumplimos plenamente con las normas de la industria, los reglamentos pertinentes y los requisitos de la norma ISO 9001:2015.

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